4.
Timing Diagram (for SPI Mode 0 (0,0)
Figure 4-1.
V IH
CS
V IL
t CSS
V IH
Synchronous Data Timing
t CSH
t CS
SCK
SI
V IL
V IH
V IL
t SU
VALID IN
t WH
t H
t WL
t V
t HO
t DIS
SO
V OH
HI-Z
HI-Z
V OL
Figure 4-2.
CS
SCK
SI
SO
Figure 4-3.
CS
SCK
SI
SO
WREN Timing
WRDI Timing
WREN OP-CODE
HI-Z
WRDI OP-CODE
HI-Z
10
Atmel AT25128B/256B
8698C–SEEPR–8/11
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